64位多核 MIPS 异常和中断结构 - 版本历史

Comcat：/* 摘要 */

2014-11-11T04:52:49Z

‎摘要

Comcat：/* 中断的特殊结构 */

2014-11-11T04:52:09Z

‎中断的特殊结构

Comcat：/* 摘要 */

2014-11-11T04:51:41Z

‎摘要

Comcat：/* 摘要 */

2014-11-11T04:51:26Z

‎摘要

Comcat：/* 摘要 */

2014-11-11T04:51:14Z

‎摘要

2014年11月11日 (二) 04:50 Comcat

2014-11-11T04:50:54Z

Comcat：/* 其它例外的子类型 */

2014-11-11T04:50:26Z

‎其它例外的子类型

Comcat：/* 其它例外的子类型 */

2014-11-11T04:50:11Z

‎其它例外的子类型

Comcat：/* 概述 */

2014-05-24T12:55:17Z

‎概述

Comcat：/* 概述 */

2014-05-24T12:55:09Z

‎概述

@@ 第267行： / 第267行： @@
 * 中断例外的 ExcCode 为 0，他的处理函数区分具体的中断是通过 CP0_STATUS 的 IP7 ~ IP0，外围的中断控制器固定链接到其中的一位 IPn (n = 6 ~ 2)，中断控制器收到中断请求时，他会向上传递这个请求，IPn 会被置 1。这样就能进入到具体的中断控制器的处理函数中，他再访问一下中断控制器内部的 ISR 就能获取到是哪个具体的设备，从而进一步进入设备中断处理函数。
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@@ 第243行： / 第243行： @@
 在 2E 上，一个用户敲击键盘的行为，中断流程是这样的：
-. 用户击键后，键盘控制器8042产生中断，这个中断链接到 (route) I8259A，并由 8259A 在CPU的中断引脚上发起中断请求
+* 用户击键后，键盘控制器8042产生中断，这个中断链接到 (route) I8259A，并由 8259A 在CPU的中断引脚上发起中断请求
-. CPU 自动设置 CAUSE 的 ExcCode 位为0，IP5 为1，并跳转到其他例外入口 0xFFFFFFFF 80000180
+* CPU 自动设置 CAUSE 的 ExcCode 位为0，IP5 为1，并跳转到其他例外入口 0xFFFFFFFF 80000180
-. 位于其他例外入口处的简单异常处理程序，根据 ExcCode 的值索引例外处理表(exception_handlers)，获取到0号例外的处理程序是 handle_int，并跳转过去
+* 位于其他例外入口处的简单异常处理程序，根据 ExcCode 的值索引例外处理表(exception_handlers)，获取到0号例外的处理程序是 handle_int，并跳转过去
-. handle_int 根据 CAUSE 之 IP 位的值跳转到中断控制器 8259A 相关的中断处理函数  i8259_irqdispatch()
+* handle_int 根据 CAUSE 之 IP 位的值跳转到中断控制器 8259A 相关的中断处理函数  i8259_irqdispatch()
-.  i8259_irqdispatch() 读取 8259A 之 In-Service Register (ISR, 注意与x86的差异，x86是由8259A主动将中断号送上数据总线的)，通过简单的计算得到中断号，进而调用 do_IRQ 进入相应的键盘中断处理函数
+* i8259_irqdispatch() 读取 8259A 之 In-Service Register (ISR, 注意与x86的差异，x86是由8259A主动将中断号送上数据总线的)，通过简单的计算得到中断号，进而调用 do_IRQ 进入相应的键盘中断处理函数

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第261行：		第261行：

	* 四个高优先级例外，对应四个固定入口。前三个 Reset，TLB Refill，Cache Error 需要系统尽可能快地进入处理函数，因此他们的处理函数直接位于固定入口处。		* 四个高优先级例外，对应四个固定入口。前三个 Reset，TLB Refill，Cache Error 需要系统尽可能快地进入处理函数，因此他们的处理函数直接位于固定入口处。
−

	* 所有其他例外共享第四个入口，统称一般例外 (General Exception)。他的处理函数区分具体哪个例外是通过 CP0_STATUS 的 ExcCode		* 所有其他例外共享第四个入口，统称一般例外 (General Exception)。他的处理函数区分具体哪个例外是通过 CP0_STATUS 的 ExcCode

@@ 第261行： / 第261行： @@
 * 四个高优先级例外，对应四个固定入口。前三个 Reset，TLB Refill，Cache Error 需要系统尽可能快地进入处理函数，因此他们的处理函数直接位于固定入口处。
 * 所有其他例外共享第四个入口，统称一般例外 (General Exception)。他的处理函数区分具体哪个例外是通过 CP0_STATUS 的 ExcCode
 * 中断例外的 ExcCode 为 0，他的处理函数区分具体的中断是通过 CP0_STATUS 的 IP7 ~ IP0，外围的中断控制器固定链接到其中的一位 IPn (n = 6 ~ 2)，中断控制器收到中断请求时，他会向上传递这个请求，IPn 会被置 1。这样就能进入到具体的中断控制器的处理函数中，他再访问一下中断控制器内部的 ISR 就能获取到是哪个具体的设备，从而进一步进入设备中断处理函数。

@@ 第260行： / 第260行： @@
 == 摘要 ==
-四个高优先级例外，对应四个固定入口。前三个 Reset，TLB Refill，Cache Error 需要系统尽可能快地进入处理函数，因此他们的处理函数直接位于固定入口处。
+* 四个高优先级例外，对应四个固定入口。前三个 Reset，TLB Refill，Cache Error 需要系统尽可能快地进入处理函数，因此他们的处理函数直接位于固定入口处。
-所有其他例外共享第四个入口，统称一般例外 (General Exception)。他的处理函数区分具体哪个例外是通过 CP0_STATUS 的 ExcCode
+* 所有其他例外共享第四个入口，统称一般例外 (General Exception)。他的处理函数区分具体哪个例外是通过 CP0_STATUS 的 ExcCode
-中断例外的 ExcCode 为 0，他的处理函数区分具体的中断是通过 CP0_STATUS 的 IP7 ~ IP0，外围的中断控制器固定链接到其中的一位 IPn (n = 6 ~ 2)，中断控制器收到中断请求时，他会向上传递这个请求，IPn 会被置 1。这样就能进入到具体的中断控制器的处理函数中，他再访问一下中断控制器内部的 ISR 就能获取到是哪个具体的设备，从而进一步进入设备中断处理函数。
+* 中断例外的 ExcCode 为 0，他的处理函数区分具体的中断是通过 CP0_STATUS 的 IP7 ~ IP0，外围的中断控制器固定链接到其中的一位 IPn (n = 6 ~ 2)，中断控制器收到中断请求时，他会向上传递这个请求，IPn 会被置 1。这样就能进入到具体的中断控制器的处理函数中，他再访问一下中断控制器内部的 ISR 就能获取到是哪个具体的设备，从而进一步进入设备中断处理函数。
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@@ 第175行： / 第175行： @@
         Int        中断
         Mod       TLB 修改异常
-        TLBL       TLB 读异常
+        TLBL      TLB 读异常
-        TLBS       TLB 写异常
+        TLBS      TLB 写异常
-        AdEL       读地址错误异常
+        AdEL      读地址错误异常
-        AdES       写地址错误异常
+        AdES      写地址错误异常
 ......
-        Sys         系统调用异常
+        Sys       系统调用异常
 ......
        保留

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第17行：		第17行：

	首先看一个系统调用异常发生时的现场过程，当用户态进程执行到 'syscall' 指令时，CPU 触发系统调用异常，MIPS 这样响应：		首先看一个系统调用异常发生时的现场过程，当用户态进程执行到 'syscall' 指令时，CPU 触发系统调用异常，MIPS 这样响应：
		+

	a. 将引起异常的 syscall 指令所在地址压入 EPC		a. 将引起异常的 syscall 指令所在地址压入 EPC

@@ 第16行： / 第16行： @@
-首先看一个系统调用异常发生时的现场过程：
+首先看一个系统调用异常发生时的现场过程，当用户态进程执行到 'syscall' 指令时，CPU 触发系统调用异常，MIPS 这样响应：
-−
-用户执行 'syscall' 指令，触发系统调用异常，MIPS 这样响应：
 a. 将引起异常的 syscall 指令所在地址压入 EPC