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== rtc_init_clk == <source lang=bash> 0x4008fd18 <rtc_init_clk>: entry a1, 32 0x4008fd1b <rtc_init_clk+3>: beqz a2, 0x4008fd30 <rtc_init_clk+24> 0x4008fd1e <rtc_init_clk+6>: slli a8, a2, 16 0x4008fd21 <rtc_init_clk+9>: extui a2, a2, 0, 16 /* p1[15:0], 1st parameter of rtc_init_clk */ 0x4008fd24 <rtc_init_clk+12>: or a2, a8, a2 0x4008fd27 <rtc_init_clk+15>: l32r a8, 0x4008f9c0 /* a8 = 0x3ff480b0, RTC_CNTL_STORE4_REG */ 0x4008fd2a <rtc_init_clk+18>: memw 0x4008fd2d <rtc_init_clk+21>: s32i a2, a8, 0 0x4008fd30 <rtc_init_clk+24>: movi.n a10, 0 0x4008fd32 <rtc_init_clk+26>: call8 0x4008fac4 <rtc_set_cpu_freq> 0x4008fd35 <rtc_init_clk+29>: l32r a2, 0x40084bf0 /* a2 = 0x6000e044 */ 0x4008fd38 <rtc_init_clk+32>: l32r a8, 0x4008fd04 /* a8 = 0x0003ff00 */ 0x4008fd3b <rtc_init_clk+35>: memw 0x4008fd3e <rtc_init_clk+38>: l32i.n a9, a2, 0 /* a9 = *(0x6000e044) = 0x0003e02d */ 0x4008fd40 <rtc_init_clk+40>: extui a6, a6, 0, 8 /* p5[7:0], 5th parameter of rtc_init_clk */ 0x4008fd43 <rtc_init_clk+43>: or a8, a9, a8 0x4008fd46 <rtc_init_clk+46>: memw 0x4008fd49 <rtc_init_clk+49>: s32i.n a8, a2, 0 0x4008fd4b <rtc_init_clk+51>: memw 0x4008fd4e <rtc_init_clk+54>: l32i.n a10, a2, 0 0x4008fd50 <rtc_init_clk+56>: l32r a9, 0x4008fd08 /* a9 = 0xfffdbfff */ 0x4008fd53 <rtc_init_clk+59>: l32r a8, 0x4008e58c /* a8 = 0x3ff4807c, RTC_CNTL_REG */ 0x4008fd56 <rtc_init_clk+62>: and a9, a10, a9 0x4008fd59 <rtc_init_clk+65>: memw 0x4008fd5c <rtc_init_clk+68>: s32i.n a9, a2, 0 0x4008fd5e <rtc_init_clk+70>: memw 0x4008fd61 <rtc_init_clk+73>: l32i.n a9, a8, 0 0x4008fd63 <rtc_init_clk+75>: l32r a2, 0x4008fd0c /* a2 = 0xffc03fff, BIT[21:14], SCK_DCAP */ 0x4008fd66 <rtc_init_clk+78>: slli a6, a6, 14 0x4008fd69 <rtc_init_clk+81>: and a9, a9, a2 0x4008fd6c <rtc_init_clk+84>: or a6, a6, a9 0x4008fd6f <rtc_init_clk+87>: l32r a2, 0x4008e53c /* a2 = 0x3ff48070, RTC_CNTL_CLK_CONF_REG */ 0x4008fd72 <rtc_init_clk+90>: memw 0x4008fd75 <rtc_init_clk+93>: s32i.n a6, a8, 0 0x4008fd77 <rtc_init_clk+95>: memw 0x4008fd7a <rtc_init_clk+98>: l32i.n a8, a2, 0 0x4008fd7c <rtc_init_clk+100>: l32r a6, 0x4008fd10 /* a6 = 0xfe01ffff, BIT[24:17], CK8M_DFREQ */ 0x4008fd7f <rtc_init_clk+103>: extui a7, a7, 0, 8 /* p6[7:0] */ 0x4008fd82 <rtc_init_clk+106>: and a6, a8, a6 0x4008fd85 <rtc_init_clk+109>: slli a7, a7, 17 0x4008fd88 <rtc_init_clk+112>: or a7, a7, a6 0x4008fd8b <rtc_init_clk+115>: memw 0x4008fd8e <rtc_init_clk+118>: s32i.n a7, a2, 0 0x4008fd90 <rtc_init_clk+120>: memw 0x4008fd93 <rtc_init_clk+123>: l32i.n a7, a2, 0 0x4008fd95 <rtc_init_clk+125>: l32r a6, 0x4008fd14 /* a6 = 0xffff8fff, BIT[14:12], CK8M_DIV_SEL */ 0x4008fd98 <rtc_init_clk+128>: extui a4, a4, 0, 3 /* p3[2:0], 3rd parameter of rtc_init_clk */ 0x4008fd9b <rtc_init_clk+131>: and a6, a7, a6 0x4008fd9e <rtc_init_clk+134>: slli a4, a4, 12 0x4008fda1 <rtc_init_clk+137>: or a4, a4, a6 0x4008fda4 <rtc_init_clk+140>: memw 0x4008fda7 <rtc_init_clk+143>: s32i a4, a2, 0 0x4008fdaa <rtc_init_clk+146>: call8 0x4008f5f4 <===== rtc_xtal_32k_enable(); 0x4008fdad <rtc_init_clk+149>: movi.n a11, 1 0x4008fdaf <rtc_init_clk+151>: mov.n a10, a11 0x4008fdb1 <rtc_init_clk+153>: call8 0x4008f688 <rtc_8m_ena> /* rtc_8m_ena(1, 1) */ 0x4008fdb4 <rtc_init_clk+156>: movi.n a10, 50 0x4008fdb6 <rtc_init_clk+158>: l32r a8, 0x40080850 /* a8 = 0x40008534 */ 0x4008fdb9 <rtc_init_clk+161>: callx8 a8 /* ets_delay_us(50) */ 0x4008fdbc <rtc_init_clk+164>: mov.n a10, a3 /* p2, 2nd parameter of rtc_init_clk */ 0x4008fdbe <rtc_init_clk+166>: call8 0x4008f87c <rtc_set_fast_freq> /* rtc_set_fast_freq(p2) */ 0x4008fdc1 <rtc_init_clk+169>: memw /* RTC_CNTL_FAST_CLK_RTC_SEL : R/W ;bitpos:[29] ;default: 1'b0; fast_clk_rtc sel. 0: XTAL div 4 1: CK8M */ 0x4008fdc4 <rtc_init_clk+172>: l32i.n a7, a2, 0 /* a7 = read RTC_CNTL_CLK_CONF_REG */ 0x4008fdc6 <rtc_init_clk+174>: l32r a6, 0x4008af18 /* a6 = 0x3fffffff, BIT[31:30], slow_clk_rtc sel */ 0x4008fdc9 <rtc_init_clk+177>: slli a4, a5, 30 /* p4, 4th parameter of rtc_init_clk */ 0x4008fdcc <rtc_init_clk+180>: and a6, a7, a6 0x4008fdcf <rtc_init_clk+183>: or a4, a4, a6 0x4008fdd2 <rtc_init_clk+186>: memw 0x4008fdd5 <rtc_init_clk+189>: s32i.n a4, a2, 0 /* RTC_CNTL_ANA_CLK_RTC_SEL : R/W ;bitpos:[31:30] ;default: 2'd0; 0: SLOW_CK 1: CK_XTAL_32K 2: CK8M_D256_OUT*/ 0x4008fdd7 <rtc_init_clk+191>: movi a10, 0x12c 0x4008fdda <rtc_init_clk+194>: l32r a8, 0x40080850 0x4008fddd <rtc_init_clk+197>: callx8 a8 /* ets_delay_us(300) */ 0x4008fde0 <rtc_init_clk+200>: movi.n a11, 0 0x4008fde2 <rtc_init_clk+202>: bne a3, a11, 0x4008fded <rtc_init_clk+213> 0x4008fde5 <rtc_init_clk+205>: beqi a5, 2, 0x4008fded <rtc_init_clk+213> 0x4008fde8 <rtc_init_clk+208>: mov.n a10, a11 0x4008fdea <rtc_init_clk+210>: call8 0x4008f688 <rtc_8m_ena> 0x4008fded <rtc_init_clk+213>: beqi a5, 1, 0x4008fe04 <rtc_init_clk+236> 0x4008fdf0 <rtc_init_clk+216>: l32r a2, 0x4008cb08 /* a2 = 0x3ff4848c, RTC_IO_XTAL_32K_PAD_REG */ 0x4008fdf3 <rtc_init_clk+219>: l32r a3, 0x4008cb04 /* a3 = 0xfff7ffff, BIT[19] */ 0x4008fdf6 <rtc_init_clk+222>: memw 0x4008fdf9 <rtc_init_clk+225>: l32i.n a4, a2, 0 0x4008fdfb <rtc_init_clk+227>: and a3, a4, a3 /* clear BIT[19] of XTAL_32K_PAD_REG */ 0x4008fdfe <rtc_init_clk+230>: memw 0x4008fe01 <rtc_init_clk+233>: s32i a3, a2, 0 /* Power down 32kHz crystal oscillator */ 0x4008fe04 <rtc_init_clk+236>: retw.n </source> So: <source lang=c> void rtc_init_clk(uint32_t st, uint8_t fast_clk_sel, uint8_t ck8m_divider, uint8_t slow_clk_sel,uint8_t sck_dcap,uint8_t ck8_dfreq); </source> <br>
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