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== Interrupt == 嵌套向量中断控制器 (NVIC) ,支持 32 个外部中断请求(IRQ), 1 个不可屏蔽中断(NMI) Cortex-M0+ 的中断向量表,位于存储器空间的开始位置,注意主栈指针(MSP)的初始值位于第一个入口: [[文件:Cortex-m0plus-int-vec-table.png]] 中断号定义于 '''arch/hc32/common/hc32l13x.h:''' <source lang=cpp> /* Interrupt Number Definition */ typedef enum IRQn { NMI_IRQn = -14, /* 2 Non Maskable */ HardFault_IRQn = -13, /* 3 Hard Fault */ SVC_IRQn = -5, /* 11 SV Call */ PendSV_IRQn = -2, /* 14 Pend SV */ SysTick_IRQn = -1, /* 15 System Tick */ PORTA_IRQn = 0 , PORTB_IRQn = 1 , PORTC_IRQn = 2 , PORTD_IRQn = 3 , DMAC_IRQn = 4 , TIM3_IRQn = 5 , UART0_IRQn = 6 , UART1_IRQn = 7 , LPUART0_IRQn = 8 , LPUART1_IRQn = 9 , SPI0_IRQn = 10, SPI1_IRQn = 11, I2C0_IRQn = 12, I2C1_IRQn = 13, TIM0_IRQn = 14, TIM1_IRQn = 15, TIM2_IRQn = 16, LPTIM_IRQn = 17, ADTIM4_IRQn = 18, ADTIM5_IRQn = 19, ADTIM6_IRQn = 20, PCA_IRQn = 21, WDT_IRQn = 22, RTC_IRQn = 23, ADC_IRQn = 24, PCNT_IRQn = 25, VC0_IRQn = 26, VC1_IRQn = 27, LVD_IRQn = 28, LCD_IRQn = 29, FLASH_RAM_IRQn = 30, CLKTRIM_IRQn = 31, } IRQn_Type; </source> PortA, B, C, D 为 GPIO 中断处理入口 四个口的对应寄存器: * 中断状态寄存器 Px_STAT 地址分别为: 0x200, 0x240, 0x280, 0x2C0 (PA_STAT, PB_STAT, PC_STAT, PD_STAT) * 中断清除寄存器 Px_ICLR 地址分别为: 0x210, 0x250, 0x290, 0x2D0 <br>
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